MIPI M-PHY的协议解码
使用M-PHY总线的MIPI接口(如DigRFV4、LLIUniPro等)目前还是比较新的标准,很多功能还在开发过程中,用户在实际的应用过程中除了会遇到信号质量的问题外,还可能会遇到各种各样协议方面的问题。如果要对相应的协议做具体的分析和调试,需要使用的协议分析仪(如Agilent公司的DigRF协议分析仪和训练器),的协议分析仪可以有很深的内存深度,可以针对相应的协议设置多级的复杂触发,可以对不关心的数据包进行相应的过滤,因此很多芯片厂家会选择的协议分析进行协议测试。而对于很多具体的使用者来说,可能只需要简单地了解一下总线上当前的状态,能够分析示波器上当前捕获的这段波形中传输的是什么数据包以及包里的具体内容,这时候就可以考虑选择示波器里的协议解码功能。
例如基于示波器的N8807ADigRFV4协议解码软件、N8808AUniPro协议解码软件、N8809ALLI协议解码软件、N8818AUFS协议解码软件等。图14.8~图14.10是几个在示波器里进行M-PHY总线解码的例子。 MIPI-DSI是MIPI联盟移动设备提出的一种高速,低功耗的串行接口,可高分辨率显示,降低显示模块功耗需求;河南MIPI测试故障
高速运行的物理层D-PHY的物理层由一个时钟和四条数据通路[D0:D3]组成,可以以非常高的速度运行。物理层可以支持不同的协议层。例如,摄像机捕捉的影像可以通过采用CSI-2协议的D-PHY物理层传送到处理器,再传送到应用处理器,然后通过采用DSI协议的D-PHY物理层传送到显示器。这里的CSI和DSI指D-PHY上运行的协议。每条通路上的数据在使用V1.2标准时传送速率可以达到2.5Gbps,在使用V2.1标准时可以达到4.5Gbps,从而可以传送高分辨率和高清晰度的影像。河南MIPI测试故障时序测试:测试MIPI接口的信号时序是否符合规范,包括时钟频率、数据延迟、数据速率等;
电路结构
在高速模式下,主机端的差分发送模块以差分信号驱动互连线,高速通道上呈现两种状态,differentia-0differential-1,从属端的高速接收单元将低摆幅的差分数据通过高速比较器转换成逻辑电平。在串行转并行模块中,高速时钟对数据进行双沿采样,将高速串行数据转换成两路并行数据,交给后续数字电路处理。高速接收单元的总体电路结构。
输入终端电阻由于输入数据信号频率高,需要进行阻抗匹配,因此在比较器的差分输入端dp/dn之间跨接了100欧姆终端电阻,由开关进行控制,当系统要进行高速数据传输时,就将该终端电阻使能。由于电阻值随工艺角、温度笔变化比较大,因此在终端电阳RO(50欧姆)的其础上增加了一个电阳,分别由三位控制信号控制,可通过改变控制字改变电阻大小,使终端电阻值在各工艺角及温度下均能满足协议要求。比较器终端电阻电路结松。
在四条通路之间,在以2.5 Gbps/路运行时,D-PHY 1.2信号的最大吞吐量约为10 Gbps。物理层信号有两种模式:高速(HS)模式和低功率(LP)模式。高速[HS]模式用于快速传送数据。在系统处于空闲时,低功率[LP]模式用来传送控制信息,以延长电池续航时间。HS和LP模式有不同的端接方式,系统应能够动态改变端接方式,以支持这两种模式
HS数据的速度越高,显示器能够支持的分辨率越高,影像的清晰度也就越好。数据速率与分辨率之间的关系,还要看一下其他几个参数。
●像素时钟:决定着像素传送的速率
●刷新速率:屏幕每秒刷新次数
●色彩深度:用来表示一个像素的颜色的位数像素时钟的推导公式如下:像素时钟=水平样点数x垂直行数x刷新速率。其中水平样点数和垂直行数包括水平和垂直消隐间隔。 HS模式下时钟和数据线间的时序关系测试;
液晶屏接口类型有LVDS接口、MIPIDSIDSI接口(下文只讨论液晶屏LVDS接口,不讨论其它应用的LVDS接口,因此说到LVDS接口时无特殊说明都是指液晶屏LVDS接口),它们的主要信号成分都是5组差分对,其中1组时钟CLK,4组DATA(MIPIDSI接口中称之为lane),它们到底有什么区别,能直接互联么?在网上搜索“MIPIDSI接口与LVDS接口区别”找到的答案基本上是描述MIPIDSI接口是什么,LVDS接口是什么,没有直接回答该问题。深入了解这些资料后,有了一些眉目,整理如下。首先,两种接口里面的差分信号是不能直接互联的,准确来说是互联后无法使用,MIPIDSI转LVDS比较简单,有现成的芯片,例如ICN6201、ZA7783;LVDS转MIPIDSI比较复杂暂时没看到通用芯片,基本上是特制模块,而且原理也比较复杂。其次,它们的主要区别总结为两点:1、LVDS接口只用于传输视频数据,MIPIDSI不仅能够传输视频数据,还能传输控制指令;2、LVDS接口主要是将RGBTTL信号按照SPWG/JEIDA格式转换成LVDS信号进行传输,MIPIDSI接口则按照特定的握手顺序和指令规则传输屏幕控制所需的视频数据和控制数据。MIPI D-PHY的信号质量的测试方法;河南MIPI测试故障
MIPI D-PHY的接收端容限测试;河南MIPI测试故障
2,MIPID-PHY测试项目
(1)DataLaneHS-TXDifferentialVoltages
(2)DataLaneHS-TXDifferentialVoltageMismatch
(3)DataLaneHS-TXSingle-EndedOutputHighVoltages(
4)DataLaneHS-TXStaticCommon-ModeVoltages
(5)DataLaneHS-TXStaticCommon-ModeVoltageMismatchΔV_CMTX(1,0)
(6)DataLaneHS-TXDynamicCommon-LevelVariationsBetween50-450MHz
(7)1.3.10DataLaneHS-TXDynamicCommon-LevelVariationsAbove450MHz
(8)DataLaneHS-TX20%-80%RiseTime
(9)DataLaneHS-TX80%-20%FallTime
(10)DataLaneHSEntry:T_LPXValue
(11)DataLaneHSEntry:T_HS-PREPAREValue
(12)DataLaneHSEntry:T_HS-PREPARE+T_HS-ZEROValue
(13)DataLaneHSExit:T_HS-TRAILValue
(14)DataLaneHSExit:30%-85%Post-EoTRiseTimeT_REOT
(15)DataLaneHSExit:T_EOTValue
(16)DataLaneHSExit:T_HS-EXITValue
(17)HSEntry:T_CLK-PREValue
(18)HSExit:T_CLK-POSTValue
(19)HSClockRisingEdgeAlignmenttoFirstPayloadBit
(ata-to-ClockSkew(T_SKEW[TX])
(21)ClockLaneHSClockInstantaneous:UI_INSTValue
(22)ClockLaneHSClockDeltaUI:(ΔUI)Value 河南MIPI测试故障
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